定做【红芯】FPGA 数字转盘播放器192K 24bit （时钟输入加强版）

•                              【红芯】FPGA 数字转盘播放器
• 技术说明：
• *采用多时钟域的设计架构
• *同轴、平衡输出采用差分驱动
• *频响更优秀的进口数字变痒
• *分离的采用 LT1085 的 LDO 提供双路电源，BC电容加AVX 正品大容量钽电容滤波网络
• *采用进口仪器拆机C型变痒（可按要求定做110V或220V），双电源供电
• *全新瑞士Schaffner/夏弗纳品质高多功能电源输入滤波插座

• 支持格屎

  • WAV : 16bit - 44.1K / 48K / 88.2K / 96K / 176.4K / 192K
  • WAV : 24bit - 44.1K / 48K / 88.2K / 96K / 176.4K / 192K
  • WAV + CUE 关联播放，支持快进、快退
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  • APE : 16bit - 44.1k 压缩等级：fast & normal
  • APE : 16bit - 48k 压缩等级：fast
  • APE + CUE 关联播放，支持快进、快退
  •  
  • FLAC : 16bit - 44.1K / 48K / 88.2K / 96K 压缩等级： 0 ~ 4
  • FLAC : 24bit - 44.1K 压缩等级： 0 ~ 4
  •  
  • DSD 格式
  • DSF : DSD64 / 2.822400MHz ,1bit DoP 或 源码输出 （可通过设置来切换）
  • 支持快进、快退

  

  支持语言：

  • 简体中文
  • 繁体中文
  • 英 文

产品特点:

• 纯 FPGA 架构， 非传统单片机或 ARM 方案
• 支持 SD / SDHC / SDXC 卡做音源，非常高支持到128G，支持 TF 卡加卡套。
• 输出端子：I2S 数字接口，AES/EBU，光纤，同轴，全部隔离输出。
• 采用 3.5 英寸 IPS 大尺寸液晶屏，480 X 320 高分辨率，无可视角度限制
• 支持 APE ,FLAC ,WAV , DSF 等无损格尸非常高支持到 192K, 24BIT（仅 WAV）。
• 可使用 9~12V 电池供电，支持交流和直流直接供电，无需再关心正负极性。
• 时钟 jitter < 50ps (采用 WM8805 SPDIF 收发器）
• 支持远程智能固件升级，升级过程中意外断电保护
• 采用 ALTERA 非常新型的 Cyclone IV FPGA 逻辑器件做为主控
• 内建 I2S 音频总线直接合成算法，对非常高支持 96K 采样率及以下的老款 DAC 自动降低位速率周期以提高兼容性。
• 内建 I2C 控制总线协议，动态灵活配置外设单模块。
• 内建 DSD DoP 时序生成器。
• 内建硬件异步 FIFO ，采用多时钟域分离的设计架构，使解码和输出结构完全独立。
• 内建高速 SD 卡独立控制器
• 内建大容量 SDRAM 控制器
• 内建高灵敏度红外遥控解码算法，即使 8 米开外，也能遥控自如
• 随机记忆体采用铁电存储器，无限次改写
• • 数字转盘信息显示采用高清晰液晶屏，配上十分简洁的用户界面，努力做到功能清晰、定位明确，原汁原味的工程师风格，一点也不拖泥带水。
  • 内部集成高灵敏度红外遥控解码算法，即使在8米开外遥控也能运用自如。
  • 极快速的文件解析：一张装满上千首音乐的 32G 卡，2 秒完成扫描并开始播放
  • 远程智能固件升级程序，即使升级过程中意外断电，也能自动恢复，不用担心机器变 “砖头”
  • 为什么要选用三晶振：
  • (咨询特价)92M，24.576M , 分别对应 44.1K, 48K 及其倍频的采样率。12M 对应同轴的专用 SPDIF 发射器。设计者通过对比通过 FPGA 直接合成的 SPDIF 信号，发现内部的 PLL 升频会导致非常终输出的抖动超过200ps，因此不得不增加wm8805 及独立晶振。

  

  • 全机电源部分全部采用 LDO (线性稳压电源)，且各部分模块电源相互独立，减小干扰，这在数字电路常用开关电源的设计有所不同，虽会带来成本上的增加，但可以保障系统运行更为稳定。
  • 本转盘记忆单采用非常新型的铁电存储器，支持无限次读写。
  • 下图红芯的电源系统考虑到众多需求：
  • 可以单路交直流接入; 双路交直流直接入; 还可以从外部直接引入双路经稳压后的 5V 给主板。大大提高不同客户对电源的多样性需求。

  

  • 采用改进型的差分驱动输出电路，无耦合电容带来的信号畸变和带宽损失。
  • IIS 也采用整形驱动电路输出以减小波形传输带来的失真。
  • 三个高精度带温度补偿的有源晶振，为还原各歌曲采样率提供精准的时钟参考，同轴输出时钟也采用独立的晶振。
  • 为进一步减小 jitter, FPGA 内 I2S 生成模块直接对晶振采用逻辑分频得惮而未使用倍频技术，这就要求逻辑电路描述要采用更优秀的算法。

  

  • 硬件由超过 10 年工作经验的硬件工程师精心设计，我们更加注重 “地” 线的完整性，更低的对地阻抗能获得更非常好的数字波形，而不是杂乱无章的随意走线。

  

  

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